《EDA综合设计与实践》课程设计-用Verilog HDL设计电子钟
广东工业大学实验报告
班 成绩评定_______ 学号 3205002894 姓名 张凤珠 教师签名_______
实验题目 用Verilog HDL设计电子钟 第 17 周至 第 17 周
一、课程设计目的和要求
目的：
1. 学会使用quantusⅡ软件（编译、仿真等），并利用它进行设计一些简单的数字电路；
2. 利用实验室提供的GW48 SOPC系统主板，结合quantusⅡ软件实现电子钟的功能显示。 要求：
电子钟应实现如下功能：
1．时钟显示功能：，该电子钟正常显示小时、分钟、秒，各用2位数码管（共6位数码管）显示范围为0—23时59分59秒，分辨率为1秒，包括启动与停止。
2．校时功能：包括小时校准和分钟校准。
3．跑表：包括跑表清零、启动计时、停止及继续计时功能。
二、实验器件
实验室提供的GW48 SOPC系统主板实验箱
三、设计方案和源程序代码
首先分析电子钟要实现的三个功能，然后确定它的基本结构，因为设计时电子钟的三个基本功能都要用到数码管显示，考虑到三者为了避免竞争数码管资源的问题，因此设计时电子钟有3个主要输入按键K1、K2、K3，分别为时间显示、校时功能、跑表的启动，而且是当任一个按键按下，其余两个键都无效，即此时只有按下的键才有效，执行该键所控制功能的启动。
其次，各个功能模块的设计。A 、对于时间显示模块中，涉及到的是时分秒各个计数器的设计 ，“秒计数器”采用60进制计数器，每累计60秒，发出一个“分脉冲”信号，该信号将被送到“分计数器”。“分计数器”采用60进制计数器，每累计60分，发出一个“分脉冲”信号，该信号被送到“时计数器”。“时计数器”采用24进制计数器，可实现24小时的累计计数。 B 、对于校时模块，同样用到了上述的时分计数器，不过只是能实现校时分钟
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